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本版置顶 隐藏置顶帖 [设计工具] Xilinx vivado 2015.4 SDK的缺陷 digest 何宾 2015-12-23 32321 JDLYyear 2016-1-5 09:58
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[芯片与器件] ZC702评估板更换phy芯片后,配置文件在哪个地方修改 albert 2017-1-12 11301 albert 2017-1-12 01:45
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我用ov7725+zynq+vdma做图像传输及显示,为什么图像会有拖影呢 刺猬 2015-10-23 22113 Oracleh 2016-5-11 07:06
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[设计工具] vivado write_cfgmem -interface spix4生产SPI模式mcs失败 eyeloveu 2016-3-9 02439 eyeloveu 2016-3-9 14:17
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[嵌入式解决方案] XPS编译问题 新人帖 wangli_89 2016-3-8 01687 wangli_89 2016-3-8 03:03
[嵌入式解决方案] Xilinx FPGA权威设计指南书中例程问题 新人帖 lzwfendou 2016-1-27 01373 lzwfendou 2016-1-27 02:44
[硬件描述语言HDL] 非阻塞赋值的问题 豪豪 2016-1-20 01142 豪豪 2016-1-20 15:26
[设计工具] 请教 :Vivado怎么例化verilog模块? seaman 2015-12-14 51773 豪豪 2016-1-20 04:53
[硬件描述语言HDL] 如何减小clock skew 新人帖 twz235 2016-1-14 11310 twz235 2016-1-14 12:54
[开发套件与IP] KC705 DDR3初始化失败 easychenccy 2016-1-8 11328 vigor 2016-1-14 02:48
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